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최신 GPU는 프로세서 내부에 포함된 다수의 코어를 활용하여 높은 병렬처리가 가능하다. GPU의 높은 병렬성을 활용하는 기법 중 하나인 GPGPU 구조는 GPU에서 대부분의 CPU의 작업을 처리가 가능하게 해주며, GPU의 높은 병렬성과 하드웨어 자원을 효과적으로 활용할 수 있다. 본 논문에서는 다양한 벤치마크 프로그램을 활용하여 CTA(Cooperative Thread Array) 할당 개수 변화에 따른 메모리 효율성과 성능을 분석하고자 한다. 실험결과, CTA 할당 개수 증가에 따라 다수의 벤치마크 프로그램에서 성능이 향상되었지만, 일부 벤치마크 프로그램에서는 CTA 할당 개수 증가에 따른 성능 향상이 발생하지 않았다. 이러한 이유로는 벤치마크 프로그램에서 생성된 CTA 개수가 적거나 동시에 수행할 수 있는 CTA 개수가 정해져 있기 때문으로 판단된다. 또한, 각 벤치마크 프로그램별로 메모리 채널 정체에 따른 메모리 스톨, 내부연결망 정체에 따른 메모리 스톨, 파이프라인의 메모리 단계에서 발생하는 스톨을 분석하여 성능과의 연관성을 파악하였다. 본 연구의 분석결과는 GPGPU 구조의 병렬성 및 메모리 효율성 향상을 위한 연구에 대한 정보로 활용될 것으로 기대된다.
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V. Agarwal / 2000 / Clock rate versus IPC: the end of the road for conventional microarchitectures / Proceedings of the 27th International Symposium on Computer Architecture :248~259
K. Olukotun / 1996 / The Case for a Single-Chip Multiprocessor / Proceedings of 7th Conference on Architectural Support for Programming Languages and Operating Systems :2~11
V. Agarwal / 2000 / Clock rate versus IPC: the end of the road for conventional microArchitectures / Proceedings of 27th International Symposium on Computer Architecture :248~259
M. D. Hill / 2008 / Amdahl’s law in the multicore era / IEEE Computer 41(7):33~38
S. Y. Lee / 2015 / CAWA: coordinated warp scheduling and cache prioritization for critical warp acceleration of GPGPU workloads / Proceedings of the 42nd Annual International Symposium on Computer Architecture :515~527
K. Olukotun / 1996 / The Case for a Single-Chip Multiprocessor / Proceedings of 7th Conference on Architectural Support for Programming Languages and Operating Systems :2~11
V. Agarwal / 2000 / Clock rate versus IPC: the end of the road for conventional microArchitectures / Proceedings of 27th International Symposium on Computer Architecture :248~259
M. D. Hill / 2008 / Amdahl’s law in the multicore era / IEEE Computer 41(7):33~38
S. Y. Lee / 2015 / CAWA: coordinated warp scheduling and cache prioritization for critical warp acceleration of GPGPU workloads / Proceedings of the 42nd Annual International Symposium on Computer Architecture :515~527
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