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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2023.6
- 수록면
- 732 - 738 (7page)
- DOI
- 10.6109/jkiice.2023.27.6.732
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본 논문은 gm-cell 위치에 따라 LC 오실레이터의 성능이 어떻게 달라지는지 검증하고 최적의 위상잡음 성능을 위한 gm-cell의 layout 위치에 관하여 제안한다. 동일한 코어와 인덕터를 갖는 LC 오실레이터 2개를 설계하여 gm-cell의 위치만 다르게 설계하여 두 구조의 성능을 비교하였다. 메인 인덕터에 gm-cell을 가까이 배치할 때의 성능이 gm-cell을 인덕터에서 멀리 배치할 때보다 위상 잡음이 2 dB 좋은 결과를 얻었으며 전력 소모도 15%적은 것을 실험을 통하여 확인 하였다. 메인 인덕터에 gm-cell을 가까이 배치하는 설계 기법을 이용하여 4.8GHz 대역에서 -116.2 dBc/Hz @ 1 MHz의 위상 잡음을 얻었다. 이때 전류 소모는 0.66-mA 였고 0.8V의 공급전원을 사용하였다. 이 성능은 기존에 연구 발표된 DCO 보다 좋은 성능을 얻었으며 이 성능은 PVT변화가 생기더라도 BLE 표준을 만족시킬 수 있다.
목차
요약
ABSTRACT
Ⅰ. 서론
Ⅱ. 저전력 DCO 설계 유의 사항
Ⅲ. 저전력 DCO 설계
Ⅳ. 측정결과
Ⅴ. 결론
REFERENCES
참고문헌 (11)
참고문헌 신청
C.-W. Yao and A. L. Willson, “A 2.8-3.2-GHz fractional-N digital PLL with ADC-assisted TDC and inductively coupled fine-tuning DCO,” IEEE Journal of Solid-State Circuits, vol. 48, no. 3, pp. 698-710, Mar. 2013. DOI: 10.1109/JSSC.2012.2230543.
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