CTF 소자의 Verilog-A Model을 위한 전계 구간별 전도특성 해석

이호진; 박민규; 권기원

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자료유형: 학술대회자료

저자정보: 이호진 (성균관대학교) 박민규 (서울대학교) 권기원 (성균관대학교)

저널정보: 대한전자공학회 대한전자공학회 학술대회 2024년도 대한전자공학회 하계학술대회 논문집

발행연도: 2024.6

수록면: 855 - 858 (4page)

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기술 발전에 따라 새로운 소자들이 개발되고 있으며, 이를 시뮬레이션하기 위하여 Verilog-A 모델링을 이용할 수 있다. 본 연구에서는 charge trap 방식 소자의 동작 특성을 실제 측정 결과와 비교하여 fitting을 수행하였고, 범위에 따른 전계특성에 대한 분석을 진행하였다. 본 연구의 결과는 소자 모델링, 소규모 어레이 제작, 구동회로설계등에 서 활용 될 수 있다.

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