고속동작과 정밀도 향상을 위해 Digital Error Correction을 이용한 10비트 100MS/s Non-binary SAR ADC

강승엽; 창동진

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자료유형: 학술대회자료

저자정보: 강승엽 (충남대학교) 창동진 (충남대학교)

저널정보: 대한전자공학회 대한전자공학회 학술대회 2024년도 대한전자공학회 추계학술대회 논문집

발행연도: 2024.11

수록면: 268 - 272 (5page)

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This paper introduces a 10-bit 100-MS/s Non-binary successive approximation register (SAR) type analog-to-digital converter (ADC), using digital error correction (DEC) to correct errors during the conversion process and improve accuracy. The implemented ADC utilize a Non-binary structure, dividing the MSB capacitor of 256C into 192C, 56C, 7C, and 1C to enhance error correction capability [2]. Owing to its error-correction capability, the 1.5-GHz clock can be utilized. For considering noise, the comparator in [5] is utilized and. As a verification, 10-bit 100-MS/s ADC is implemented in 28nm CMOS process under 1-V supply voltage. The implemented ADC achieves 10 effectieve number of bits (ENoB), 74.04dB SFDR, with 0.3-mW power consumption. As a result, 3.32-J/conv. FoM is achieved through the explained technique.

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