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논문 기본 정보

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저자정보
저널정보
대한전자공학회 대한전자공학회 학술대회 대한전자공학회 2009년 SoC학술대회
발행연도
2009.5
수록면
162 - 168 (7page)

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아나로그 PR(1,2,2,1)신호를 디코딩하기 위해 새로운 비터비 디코더 회로를 제안하였다. 제안한 회로는 피드벡을 갖는 단일의 스테이지 회로이며, 0과 1 각 각에 해당하는 두 개의 블록으로 구성된다. 제안한 회로는 한 개의 스테이지로만 구성된 회로지만, 동작 시에는 트렐리스 다이아그램의 처음 3개 단과 같은 동작하는 특징이 있다. 디코딩은 상기 두 블록의 출력 값을 비교함으로서 얻을 수 있는데, 1에 해당하는 블록의 출력이 0에 해당하는 블록의 출력보다 크면 1로 디코딩하고, 그 반대이면 0으로 디코딩 한다. 제안한 회로의 출력은 피드벡에 의해 반복되어 누적되는 구조이므로, 출력이 overflow 하는 문제가 있으며, 이를 방지 하기 위해 출력 값들을 전체 출력 중 최소 값 만큼 감한 후 피드벡하는 방법을 채용하였다. 제안한 구조의 장점은 트렐리스 다이아그램 전체를 회로로 만든 구조에 비해 훨씬 간단하다는 점과 디코딩 속도가 빠르다는 점들이 있다. 본 논문에서는 제안한 구조의 원리를 설명하였으며, 회로 구현 시에 발생할 수 있는 mismatch 영향에 대해 분석하였다. 또, 제안한 회로에 대한 시뮬레이션 결과를 제시하였다.
#PRML signal #Viterbi decoder #On-Circuit decoding

목차

요약
Abstract
Ⅰ. INTRODUCTION
Ⅱ. PR (1, 2, 2, 1) SIGNAL AND CONVOLUTION CODE
Ⅲ. Decoding of PR (1, 2, 2, 1) signal with the proposed structure
Ⅳ. Simulation
Ⅴ. Conclusion
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