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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 저널정보
- 대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC : 2009
- 발행연도
- 2009.7
- 수록면
- 606 - 609 (4page)
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In this paper, we introduce a novel write back method named as the adaptive write back method to solve a memory bottleneck problem and to reduce power consumption. The key of this architecture is adaptively changing the timing of write back operation to an external memory. As a result, the proposed architecture can alleviate the memory bottleneck problem by preventing intensive memory accesses. Also we can reduce the peak power which is a critical problem for embedded systems. We have evaluated the new proposed method on 3D graphics pixel cache on a SoC environment in where various IPs are embedded. The simulation results show the effectiveness of the proposed method.
목차
Abstract
1. Introduction
2. Proposed Method
3. Implementation
4. Experiments
5. Conclusion
References
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