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- 발행연도
- 2009.11
- 수록면
- 408 - 411 (4page)
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A CMOS 3.2-Gb/s multilevel pulse amplitude modulation (PAM) transceiver is proposed. By using 4-PAM signaling, symbol rate is effectively decreased compared to the binary signaling. Data transmission is executed through current mode instead of voltage mode for high data transmission rate. 25-1 pseudo random bit sequence (PRBS) generator was designed on-chip for built-in self test (BIST) operation. The CMOS transceiver is designed in 0.18 μm CMOS process. It achieves 3.2-Gb/s data rate, and total power consumption is 148 mW.
목차
Abstract
I. INTRODUCTION
II. TRANSCEIVER ARCHITECTU
III. CIRCUIT IMPLEMENTATION
IV. MEASUREMENT RESULTS
V. CONCLUSIONS
ACKNOWLEDGMENT
REFERENCES
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