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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 저널정보
- 대한전자공학회 IEIE Transactions on Smart Processing & Computing IEIE Transactions on Smart Processing & Computing Vol.4 No.1
- 발행연도
- 2015.2
- 수록면
- 59 - 63 (5page)
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This paper presents a 10-bit 10 MS/s Time-Interleaved Flash-SAR ADC with a shared Multiplying DAC. Using shared MDAC, the total capacitance in the SAR ADC decreased by 93.75%. The proposed ADC consumed 2.28mW under a 1.2V supply and achieved 9.679 bit ENOB performance. The ADC was implemented in 0.13μm CMOS technology. The chip area was 760 × 280 μ㎡.
목차
Abstract
1. Introduction
2. Time-Interleaved Flash-SAR ADC Architecture
3. Building Blocks
4. Experimental Results
5. Conclusion
References
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