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이용수
요약
I. 서론
II. 부울생성기(Boolean Generator)
III. 결론
참고문헌
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EDIF Netlist를 이용한 PLD 설계용 툴 개발에 관한 연구 ( A Study on the Development of a Tool for PLD Design Using the EDIF Netlist )
대한전자공학회 학술대회
1995 .11
EDIF 네트리스트를 이용한 PLD구현 ( An Implementation of a PLD using EDIF netlist )
대한전자공학회 학술대회
1996 .01
EDIF 네트리스트를 이용한 PLD구현
대한전자공학회 학술대회
1996 .05
PLD 피팅을 위한 EDIF 네트리스트에서의 부울식 생성
대한전자공학회 학술대회
1997 .11
PLD 피딩을 위한 EDIF 네트리스트에서의 부울식 생성 ( The Generation of Boolean Equation From EDIF Netlist for PSD Fitting )
대한전자공학회 학술대회
1997 .11
EDIF Reader / Writer의 구현 ( Implementation of EDIF Reader / Writer )
대한전자공학회 학술대회
1992 .01
PLD 설계를 위한 Tool 개발에 관한 연구 ( A Study on the development of a Tool for PLD Design )
한국통신학회 학술대회논문집
1993 .01
PLD partition을 고려한 PLD 설계용 툴 개발
대한전자공학회 학술대회
1994 .11
PLD partition을 고려한 PLD 설계용 툴 개발 ( The development of PLD Design Tool considering PLD partition )
대한전자공학회 학술대회
1994 .11
PLD
전자공학회지
1992 .06
New Approach to Extract Netlist from Layout
ICVC : International Conference on VLSI and CAD
1997 .01
PDL 설계를 위한 툴 ( PLD Designer ) 에 관한 연구 ( A Study on the Tool ( PLD Designer ) for PLD Design )
한국통신학회 학술대회논문집
1992 .01
패턴 매칭에 의한 ASIC의 Netlist 처리에 관한 연구
제어로봇시스템학회 국내학술대회 논문집
1999 .10
영상처리 기법을 이용한 Spice-Netlist 추출기
Proceedings of KIIT Conference
2019 .06
분할이 고려된 PLD 설계 ( A PLD Design considered partition )
대한전자공학회 학술대회
1995 .01
BDD를 이용한 ECO 자동화
대한전자공학회 학술대회
2013 .11
A New Hierarchical Netlist Comparison Technique for Layout Verification
ICVC : International Conference on VLSI and CAD
1997 .01
A VHDL Generator from Logic Netlists
JTC-CSCC : Joint Technical Conference on Circuits Systems, Computers and Communications
1994 .01
EDAS_P에서 Netlist 추출방법연구 (SCHEX_P)
대한전자공학회 학술대회
1986 .12
EDAS-P에서 Netlist 추출방법 연구 ( SCHEX-P ) ( A Study on the Extraction Method of Netlist in EDAS-P )
대한전자공학회 학술대회
1986 .01
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