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논문 기본 정보
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- 저자정보
- 저널정보
- 대한전자공학회 대한전자공학회 학술대회 대한전자공학회 CAD 및 VLSI 설계 연구회 종합 학술 대회 1997 : ASIC Design Workshop, 신진 박사 논문 발표 대회 및 공개 토론회 논문집
- 발행연도
- 1997.7
- 수록면
- 171 - 188 (18page)
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목차
Abstract
Ⅰ. INTRODUCTJON
Ⅱ. RELATED WORK
Ⅲ. DATAPATH ALLOCATION
Ⅳ. DATAFATH ALLOCATION FOR PERFORMANCE AND AREA OPTIMIZATION
Ⅴ. DATAPATH ALLOCATION FOR DIVERSE TARGET ARCHITECTURES
Ⅵ. EXPERIMENTAL RESULTS
Ⅶ. SUMMARY AND CONCLUSIONS
REFERENCES
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1995 .01
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Resource-Constrained Scheduling in Automatic Datapath Synthesis
대한전자공학회 기타 간행물
1992 .01
-
데이타패스 합성을 위한 효율적 알고리즘 ( An Efficient Algorithm for Datapath Synthesis )
대한전자공학회 학술대회
1990 .01
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OPTIMIZATION ALGORITHMS OF A DATAPATH WITH REVERSIBLE ELEMENTS
JTC-CSCC : Joint Technical Conference on Circuits Systems, Computers and Communications
1992 .01
-
Topological Transformation for Application-Specific Instruction-Set Processor Datapath Synthesis
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
1996 .01
-
Topological Transformation for Application-Specific Instruction-Set Processor Datapath Synthesis
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
1996 .01
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Datapath Synthesis in Sogang Silicon Compiler
JTC-CSCC : Joint Technical Conference on Circuits Systems, Computers and Communications
1990 .01
-
YU-RISC의 DATAPATH 설계 ( DATAPATH DESIGN OF YU-RISC )
대한전자공학회 학술대회
1989 .11
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Applying Two-Phased Optimization Algorithm of a Datapath with Reversible Elements
JTC-CSCC : Joint Technical Conference on Circuits Systems, Computers and Communications
1993 .01
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Datapath 설계에서 CPLD를 이용한 분할 알고리즘 개발 ( A Development of Partitioning Algorithm for Datapath Design Using CPLD )
대한전자공학회 학술대회
1998 .01
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파이프라인 데이타패스 합성 시스템의 설계 ( Design of Pipelined Datapath Synthesis System )
대한전자공학회 학술대회
1992 .01
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파이프라인형 데이타패스 합성을 위한 스케쥴링 기법 ( A Scheduling Technique for Pipelined Datapath Synthesis )
전자공학회논문지-A
1992 .04
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데이터패스 합성에서의 비스와 레지스터의 최적화 기법 ( Bus and Register Optimization in Datapath Synthesis )
한국통신학회 학술대회논문집
1997 .01
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Evaluation of Bit-Pipelined Array Circuits for Datapath DSP Applications
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
2002 .07
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자원제약조건 하에서의 데이타패스 스케듈링 ( A Datapath Scheduling Under Resource Constraints )
한국통신학회논문지
1992 .04
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메모리 비용 최소화를 위한 데이타패스 합성 시스템의 설계 ( Design of a Datapath Synthesis System for Minimization of Multiport Memory Cost )
전자공학회논문지-A
1995 .10
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파이프라인 데이타패스 자동 생성을 위한 상위수준 합성 시스템의 설계 ( Design of a High-Level Synthesis System for Automatic Generation of Pipelined Datapath )
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[소자부품최적화] 데이터패스 합성에서의 버스와 레지스터의 최적화 기법
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