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이용수
요약
1. 서론
2. 데이터패스 스케듈링
3. 버스와 레지스터
4. 버스의 최적화
5. 실험 및 고찰
6. 결론
참고문헌
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데이터패스 합성에서의 비스와 레지스터의 최적화 기법 ( Bus and Register Optimization in Datapath Synthesis )
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대한전자공학회 학술대회
1990 .01
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1998 .01
파이프라인형 데이타패스 합성을 위한 스케쥴링 기법 ( A Scheduling Technique for Pipelined Datapath Synthesis )
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1992 .04
파이프라인 데이타패스 합성 시스템의 설계 ( Design of Pipelined Datapath Synthesis System )
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1992 .01
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1992 .04
OPTIMIZATION ALGORITHMS OF A DATAPATH WITH REVERSIBLE ELEMENTS
JTC-CSCC : Joint Technical Conference on Circuits Systems, Computers and Communications
1992 .01
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전자공학회논문지-A
1994 .07
A Flexible Datapath Allocation Method for Architectural Synthesis
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1997 .07
A Flexible Datapath Allocation Method for Architectural Synthesis
대한전자공학회 토론회
1997 .01
코드 스케줄링의 효율을 높이기 위한 레지스터 할당 알고리즘
정보과학회논문지(B)
1998 .12
단일 프로세서에서의 향상된 레지스터 파일
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1996 .10
ASIC 설계를 위한 새로운 레지스터 전송 단계 합성 방법
전기전자학회논문지
1999 .07
레지스터 할당과 코드 스케쥴링의 구조적 통합
(구)정보과학회논문지
1994 .11
RISC용 데이터 패스의 설계
대한전자공학회 학술대회
1991 .06
RISC용 데이터 패스의 설계 ( Datapath Design for RISC )
대한전자공학회 학술대회
1991 .07
Applying Two-Phased Optimization Algorithm of a Datapath with Reversible Elements
JTC-CSCC : Joint Technical Conference on Circuits Systems, Computers and Communications
1993 .01
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