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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2016.6
- 수록면
- 162 - 165 (4page)
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This paper introduces a novel architecture of voltage scaler based on a reconfigurable capacitive array. While its reconfigurable structure allows it to scale the output voltage to any target level, its energy recycling process permits the voltage scaler to supply the voltage even after the input voltage is turned off. This architecture stores the energy in the capacitor array during the voltage scaling stage, then it reconfigures these charges step-wise to boost the lost voltage level during the energy recycling stage. Using the proposed architecture, an example voltage scaler was implemented using 65 nm CMOS process, which generates an output voltage of a range 500 mV to 1.16 V from an input voltage of 500 mV. Simulations were conducted with a 32-bit adder circuit as a load, which showed a reduction in energy consumption by 45.8% compared to a conventional converter.
목차
Abstract
I. Introduction
II. Proposed Architecture
III. Simulation Results
IV. Conclusion
References
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