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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 저널정보
- 대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.17 No.3
- 발행연도
- 2017.6
- 수록면
- 333 - 340 (8page)
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In this paper, we describe HW/SW cooptimizations for reconfigurable application specific instruction-set processors (ASIPs). Based on our previous very long instruction word (VLIW) ASIP, the proposed framework realizes various forward error-correction (FEC) algorithms for wireless communication systems. In order to enhance the energy efficiency, we newly introduce several design methodologies including high-radix algorithms, tasklevel out-of-order executions, and intensive resource allocations with loop-level rescheduling. The case study on the radix-4 turbo decoding shows that the proposed techniques improve the energy efficiency by 3.7 times compared to the previous architecture.
목차
Abstract
Ⅰ. INTRODUCTION
Ⅱ. BACKGROUNDS
Ⅲ. PROPOSED OPTIMIZATIONS
Ⅳ. IMPLEMENTATION RESULTS
Ⅵ. CONCLUSION
REFERENCES
참고문헌 (14)
참고문헌 신청
Multiplexing and Channel Coding, 3GPP TS 36.212, Rev. 11.3.0, Jun. 2013.
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