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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2023.2
- 수록면
- 215 - 220 (6page)
- DOI
- 10.9717/kmms.2023.26.2.215
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In this paper, we propose a finite fields GF(2n) multiplier algorithm by repeating the 2 multiplication algorithm n-1 times with a combination circuit composed only of AND and XOR gates. The proposed algorithm can be configured with fewer gates than the existing finite fields multiplication algorithm, and is expected to be easy to implement in hardware because it is very regular. Finally, the time to perform finite fields multiplication is also expected to be faster than other multiplication algorithms due to the smaller number of gates.
목차
ABSTRACT
1. 서론
2. 관련 연구
3. 제안한 방법
4. 하드웨어 구현
5. 결론
REFERENCE
참고문헌 (16)
참고문헌 신청
A.J. Menezes, P.C. van Oorschot, and S.A. Vanstone, Handbook of Applied Cryptography, CRC Press, 1996.
J.L. Massey, “Theory and Practice of Error Control Codes,” Proceedings of the IEEE, pp. 1293-1294, 1986.
D. Hankerson, S. Vanstone, and A. Menezes, Guide to Elliptic Curve Cryptography, Springer Professional Computing, 2004.
FIPS, Advanced Encryption Standard(AES), NIST Pubs 197, 2001.
G.H. Kim, C.S. Park, and G.Y. Cho, “Symmetry Structured SPN Block Cipher Algorithm,” Journal of The Korea Multimedia Society, Vol. 15, No. 8, pp. 1093-1100, 2008.
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D. Hankerson, S. Vanstone, and A. Menezes, Guide to Elliptic Curve Cryptography, Springer Professional Computing, 2004.
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G.H. Kim, C.S. Park, and G.Y. Cho, “Symmetry Structured SPN Block Cipher Algorithm,” Journal of The Korea Multimedia Society, Vol. 15, No. 8, pp. 1093-1100, 2008.
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