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논문 기본 정보

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학술대회자료
저자정보
Yun-Hsiang Chang (National Tsing Hua University) Tsai-Fu Wu (National Tsing Hua University)
저널정보
전력전자학회 ICPE(ISPE)논문집 ICPE 2023-ECCE Asia
발행연도
2023.5
수록면
2,751 - 2,756 (6page)

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This study proposes a half-bridge dc-bus spilt-capacitor voltage balancing circuit based on DΣ control. The circuit can be designed according to the load requirements and be connected to a three-phase four-wire inverter. The balancing circuit is used to eliminate dc offsets due to process errors in the upper and lower arm dc-bus capacitor voltages and to eliminate ac components due to unbalanced loads. In addition, this method incorporates the neutral current into the calculation, so that the capacitor voltages are effectively balanced regardless of the load phase or amplitude imbalance. Finally, a dynamic model of the voltage balancing system is derived and validated with Matlab / Simulink numerical analysis software.

목차

Abstract
I. INTRODUCTION
II. SYSTEM ARCHITECTURE
III. BALANCING-CIRCUIT PARAMETERS DESIGN
IV. DESIGN AND SIMULATION RESULTS
CONCLUSION
REFERENCES

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