기약인 all-one 다항식에 의해 정의된 GF(2<SUP>m</SUP>)에서의 효율적인 비트-병렬 곱셈기

장구영; 박선미; 홍도원

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자료유형: 학술저널

저자정보: 장구영 박선미 홍도원

저널정보: 대한전자공학회 전자공학회논문지-TC 전자공학회논문지 TC편 제43권 제7호

발행연도: 2006.7

수록면: 115 - 121 (7page)

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곱셈기의 효율성은 정규 기저(normal basis), 다항식 기저(polynomial basis), 쌍대 기저(dual basis), 여분 표현(redundant representation) 등과 같은 유한체 원소의 표현 방법에 주로 의존한다. 특히 여분 표현에서의 제곱 및 모듈로 감산(modular reduction)은 단순한 방법에 의해 효율적으로 수행될 수 있기 때문에, 여분 표현은 흥미로운 유한체 표현 방법이다. 본 논문은 여분 표현을 사용한 기약인 all-one 다항식에 의해 정의된 GF(2<SUP>m</SUP>)에서의 효율적인 비트-병렬 곱셈기를 제안한다. 또한 제안된 비트-병렬 곱셈기의 효율성을 향상시키기 위해, Karatsuba에 의해 제안된 잘 알려진 곱셈 방법을 변형한다. 결과로써, 제안된 곱셈기는 all-one 다항식을 사용한 기존의 알려진 곱셈기들과 비교해 적은 공간 복잡도(space complexity)를 가지는 반면에, 제안된 곱셈기의 시간 복잡도(time complexity)는 기존의 곱셈기와 유사하다.

#finite field arithmetic #bit-parallel multiplier #redundant representation #all-one polynomial

참고문헌 (15)

참고문헌 신청

K.-Y. Chang , 2005 , Low complexity bit-parallel multiplier for definedbyall-one polynomials using redundant representation , IEEE Trans. Computers 54 (12) : 1628 ~ 1630

G.Drolet , 1998 , A New Representation of Elements of Finite Fields Yielding Small Complexity Arithmethic Circuits , IEEE Trans. Computers 47 (9) : 938 ~ 946

W.Geiselmann , 2003 , A Redun- dant Representation of for Designing ArithmeticCircuits , IEEE Trans. Computers 52 (7) : 848 ~ 853

M.A.Hasan , 1993 , A modified Massey-Omura parallel multiplier for a class of finite fields , IEEE Trans. Computers 42 (10) : 1278 ~ 1280

T. Itoh , 1989 , Structure of parallel multiplications for a class of fields , Information and Computers 83 : 21 ~ 40

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