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논문 기본 정보

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대한전자공학회 전자공학회논문지-SD 電子工學會論文誌 SD編 第46卷 第9號
발행연도
2009.9
수록면
33 - 38 (6page)

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이 논문의 연구 히스토리 (6)

2009

저오차 고정길이 그룹 CSD 곱셈기 설계
김용은 ,  조경주 ,  정진균 전자공학회논문지-SD 2009.09 학술저널

2008

곱셈기를 사용하지 않은 고속 FIR 필터를 위한 부분 항 덧셈 방법
김용은 전자공학회논문지-SD 2008.08 학술저널

2007

그룹 곱셈 계수를 위한 Modified CSD 그룹 곱셈기 디자인
김용은 ,  허일남 ,  정진균 전자공학회논문지-SD 2007.09 학술저널
그룹 곱셈 계수를 위한 Modified CSD 그룹 곱셈기 디자인
김용은 ,  홍선아 ,  정진균 대한전자공학회 학술대회 2007.07 학술대회자료
그룹 곱셈 계수를 위한 Modified CSD 그룹 곱셈기 디자인
김용은 ,  홍선아 ,  정진균 대한전자공학회 학술대회 2007.07 학술대회자료

2006

Group 부분곱을 이용한 효율적인 상수 곱셈기 설계
김용은 ,  이주영 ,  장인걸 외 2명 대한전자공학회 학술대회 2006.11 학술대회자료

초록· 키워드

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그룹 CSD 곱셈기는 프로그래머블 곱셈기에 사용되는 곱셈계수의 종류가 미리 정해져있고, 곱셈계수의 수가 많지 않은 FFT와 같은 응용에 효율적으로 사용하기 위해 최근 제안된 곱셈기이다. FFT를 비롯한 많은 DSP 응용의 VLSI 구현에서는 W비트 입력과 W비트 계수와의 곱셈 시 (2W-1)비트로 늘어나는 곱셈 출력 중 일부 비트만을 취하여 다음 연산에 사용한다. 본 논문에서는 워드길이가 W비트인 입력으로부터 W비트를 출력하는 고정길이 그룹 CSD 곱셈기 설계 방법을 제안한다. 양자화 오차를 효율적으로 보상하기 위해 그룹 CSD 곱셈기의 인코딩 신호를 이용하여 에러보상 바이어스를 생성한다. Synopsys 시뮬레이션을 통해 제안된 고정길이 그룹 CSD 곱셈기는 기존의 고정길이 modified Booth 곱셈기와 비교하여 전력소모에서 최대 84%, 면적에서 최대 79%까지 감소시킬 수 있음을 보인다.
#그룹 CSD 곱셈기 #modified Booth 곱셈기 #양자화 오차 #고정길이 곱셈기

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. GCSD 곱셈기
Ⅲ. 고정길이 GCSD 곱셈기
Ⅳ. 고정길이 Group CSD 곱셈기의 성능분석
Ⅴ. 결론
참고문헌
저자소개

참고문헌 (8)

참고문헌 신청
1. [학술대회논문] - Y. E. Kim / 2008 / Modified CSD group multiplier design for predetermined coefficient groups / in Proc. IEEE ISCAS 2008 : 3362 ~ 3365 google schola 2. [단행본] - S.W.Reitwiesner / 1966 / Binary arithmetic / Advances in Computers : 231 ~ 308 google schola 3. [학술지(정기간행물)] - J. M. Jou / 1999 / Design of a low-error fixed-width multipliers for DSP applications / IEEE Trans. Circuits Syst. Ⅱ 46 (6) : 836 ~ 842 google schola 4. [학술지(정기간행물)] - L. D. Van / 2000 / Design of the lower error fixed-width multiplier and its application / IEEE Trans. Circuits Syst. Ⅱ 47 : 1112 ~ 1118 google schola 5. [학술지(정기간행물)] - L. D. Van / 2005 / Generalized low-error area-efficient fixed-width multipliers / IEEE Trans. Circuits Syst. I 52 : 1608 ~ 1619 google schola

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