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논문 기본 정보

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학술저널
저자정보
Ui-Seok Seong (Kyungnam University) Seon-Hwan Hwang (Kyungnam University)
저널정보
전력전자학회 JOURNAL OF POWER ELECTRONICS JOURNAL OF POWER ELECTRONICS Vol.16 No.1
발행연도
2016.1
수록면
18 - 26 (9page)

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This paper proposes a compensation algorithm for reducing a specific ripple component on synchronous reference frame phase locked loop (SRF-PLL) in grid-tied single-phase inverters. In general, SRF-PLL, which is based on all-pass filter to generate virtual voltage, is widely used to estimate the grid phase angle in a single-phase system. In reality, the estimated grid phase angle might be distorted because the phase difference between actual and virtual voltages is not 90 degrees. That is, the phase error is caused by the difference between cut-off frequency of all-pass filter and grid frequency under grid frequency variation. Therefore, the effects on phase angle and output current attributed to the phase error are mathematically analyzed in this paper. In addition, the proportional resonant (PR) controller is adapted to reduce the effects of phase error. The validity of the proposed algorithm is verified through several simulations and experiments.

목차

Abstract
I. INTRODUCTION
II. ANALYSIS OF SRF-PLL SYSTEM BASED ON APF
III. PROPOSED ALGORITHM FOR REDUCING PHASE ERROR IN SRF-PLL
IV. SIMULATION RESULTS
V. EXPERIMENTS
VI. CONCLUSION
REFERENCES

참고문헌 (16)

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