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저자정보
Dhruv Garg (NIT Jalandhar) Girish Wadhwa (NIT Jalandhar) Shailendra Singh (NIT Jalandhar) Ashish Raman (NIT Jalandhar) Balwinder Raj (NITTTR Chandigarh)
저널정보
한국전기전자재료학회 Transactions on Electrical and Electronic Materials Transactions on Electrical and Electronic Materials 제22권 제6호
발행연도
2021.12
수록면
764 - 773 (10page)
DOI
https://doi.org/10.1007/s42341-021-00298-0

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This submitted work presents the 2-dimensional analytical modeling of Tunnel FET’s in consideration with the inherent properties of dual modulation effect. This eff ect explains the concept of regulating both gate and also the drain terminal biasing voltage on device surface potential and hence on the tunneling drain current model, which uses the device surface potential modeling as basis of deriving the TFET current model. The model is developed using basic 2-D Poisson’s equation. This analytical model embraces both the biasing voltage effect at gate and drain terminal respectively. The results procured from the submitted work are in perfect agreement with TCAD simulations results and depletion width of various regions defi ned in TFET is accurate and can also be explained theoretically.

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