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GIDL과 SILC가 DRAM refresh 회로의 성능저하에 미치는 영향
대한전자공학회 학술대회
1998 .06
GIDL과 SILC를 고려한 DRAM refresh 회로의 설계가이드 라인 ( The effect of GIDL and SILC on the design guideline of the refresh circuit in DRAM )
한국통신학회논문지
1999 .12
DRAM refresh parameter에 따른 컴퓨팅 성능 변화
한국정보과학회 학술발표논문집
2020 .07
1T DRAM을 위한 Block Refresh (Autonomous Refresh) 방법의 최적화
대한전자공학회 학술대회
2009 .07
메모리 접근 경향을 고려한 적응적 DRAM Refresh
대한전자공학회 학술대회
2016 .06
1T DRAM을 위한 Block Refresh (Autonomous Refresh) 방법의 최적화
대한전자공학회 학술대회
2009 .07
스트레스에 의한 누설전류가 DRAM의 refresh time에 미치는 영향에 관한 연구 ( The Impact of Stress Induced Leakage Current on the Refresh Time in DRAM )
한국통신학회논문지
2000 .12
The Study on Impurity Concentration Optimizing for the Refresh Time Improvement of DRAM
대한전자공학회 학술대회
2000 .11
SILC 특성에 의한 실리콘 산화막의 신뢰성 연구
대한전자공학회 학술대회
2002 .06
DRAM의 성능 향상을 위한 Pre-Refresh 기법
한국정보기술학회논문지
2018 .10
채널 구조에 따른 1T-DRAM Cell의 메모리 특성
전기전자재료학회논문지
2012 .01
저전력 DRAM을 위한 리프레시 주기 설정 기법
한국정보과학회 학술발표논문집
2009 .06
[박사학위 논문초록] 고성능 및 저전력 3D 적층형 DRAM에 관한 연구
전자공학회지
2019 .12
DRAM 특집을 내면서
전기의세계
1989 .04
A fine-grained refresh scheme for a DRAM power reduction in deep learning applications
대한전자공학회 학술대회
2018 .06
다양한 DRAM Refresh 동작을 지원하는 Hybrid LDO Regulator 설계
대한전자공학회 학술대회
2020 .08
Investigation and Optimization of Double-gate MPI 1T DRAM with Gate-induced Drain Leakage Operation
JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE
2019 .04
The Trap Characteristics of SILC in Silicon Oxide for SoC
ICEIC : International Conference on Electronics, Informations and Communications
2004 .08
초박막의 N2O 어닐링한 터널링 산화막을 갖는 Flash Memory Cell의 SILC 특성 및 성능 ( Performance and SILC Characteristics of Flash Memory Cell With Ultra thin N2O Annealed Tunneling Oxide )
전자공학회논문지-D
1999 .10
산화막 변화에 의한 p-MOSFET에서 게이트에 유기된 드레인 누설 ( GIDL ) 전류 ( GIDL Current Effects in p-MOSFET's by gate oxide variation )
대한전자공학회 학술대회
1994 .01
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