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자료유형
학술대회자료
저자정보
이동우 (서울대학교) 최기영 (서울대학교)
저널정보
대한전자공학회 대한전자공학회 학술대회 2015년도 대한전자공학회 정기총회 및 추계학술대회
발행연도
2015.11
수록면
60 - 63 (4page)

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Die-stacked DRAM provides higher bandwidth than conventional off-package DRAM, motivating many researches on utilizing it as a cache of off-package DRAM. This paper proposes to apply the bandwidth-aware self-balancing dispatch scheme to a direct mapped DRAM cache which has much lower hit latency than set-associative one. It also proposes to adopt the dirty-block index scheme to reduce the overhead of dirty-region tracker. The simulation results show that our technique obtains higher performance than the previous approach to direct mapped DRAM cache.

목차

Abstract
I. 서론
Ⅱ. 기존 연구
Ⅲ. 제안하는 방식
Ⅳ. 실험 결과
Ⅴ. 결론 및 향후 연구 방향
참고문헌

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