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논문 기본 정보

자료유형
학술저널
저자정보
이종복 (한성대학교)
저널정보
한국디지털콘텐츠학회 디지털콘텐츠학회논문지 디지털콘텐츠학회논문지 제18권 제5호
발행연도
2017.8
수록면
943 - 948 (6page)

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현재, 특정한 응용분야에 적합하도록 설계된 임베디드 시스템이 가전제품, 스마트폰, 자율주행 자동차, 로봇, 공장제어 등의 분야에 광범위하게 쓰이고 있다. 아울러, 임베디드 시스템을 구성하는 임베디드 프로세서의 성능에 지대한 영향을 미치는 DRAM의 중요성이 날로 증가되어, DRAM에 대한 연구가 산업계와 학계에서 활발하게 진행되고 있다. 모의실험을 통하여 임베디드 프로세서의 성능을 평가할 때 신뢰할만한 결과를 얻기 위하여, 보다 정확한 DRAM 모델을 갖추는 것이 중요하다. 본 논문에서는 이것을 위하여, DRAM 시뮬레이터와 연동할 수 있는 임베디드 프로세서 모의실험기를 개발하였다. 그리고, MiBench 임베디드 벤치마크를 입력으로, 싸이클 단위로 정확하게 동작하는 DRAM 모델이 임베디드 프로세서의 성능에 끼치는 영향을 분석하였다.
#DRAM #임베디드 프로세서 #성능 #DRAM #Embedded processor #Performance

목차

요약
Abstract
I. 서론
II. DRAM의 모델
III. 임베디드 프로세서 모의실험기
IV. 모의실험 환경
V. 모의실험 결과
VI. 결론
참고문헌

참고문헌 (9)

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[학술지(정기간행물)] - J. Balfour / 2008 / An Energy-Efficient Processor Architecture for Embedded Systems / IEEE Computer Architectures 7 (1) google schola [학술지(정기간행물)] - P. Rosenfeld / 2011 / DRAMSim2: A Cycle Accurate Memory System Simulator / IEEE Computer Architecture Letters google schola [학술대회논문] - Y. Kim / 2012 / A Case for Exploiting Subarray-Level Parallelism (SALP) in DRAM / ISCA google schola [학술대회논문] - D. Lee / 2013 / Tiered-Latency DRAM : A Low Latency and Low Cost DRAM Architecture / HPCA google schola [학술대회논문] - M. R. Guthaus / 2001 / MiBench : A free, commercial representative embedded benchmark suite / Workload Characterization : 3 ~ 14 google schola

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