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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2015.1
- 수록면
- 13 - 24 (12page)
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본 논문에서는 스마트카드 적용을 위한 저전력 AES(Advanced Encryption Standard) 암호 프로세서 설계를 제안한다. 제안한 방법에서는 휴대용 기기에 필수적인 작은 면적과 저전력을 위하여 ByteSub변환과정과 MixColumn변환과정에 대한 개선된 룩업 테이블을 구성하였다. 설계된 AES 암호 프로세서는 Verilog-HDL를 사용하여 구조적 모델링을 하였으며, Xilinx사의 ISE 10.2c 툴을 이용하여 논리 합성을 수행하였다. 설계 검증은 Modelsim 6.2c 툴을 이용하여 타이밍 시뮬레이션을 수행하였으며, Xilinx FPGA Virtex2(XC2V3000) 소자를 사용하여 하드웨어 동작을 검증하였다. 논리 합성 결과를 통하여 Slice는 총 1,589개가 사용되었고, 최대 클럭 속도는 약 89.7 MHz이동작함을 확인하였다.
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참고문헌 (10)
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Yadollah Eslaim / 2006 / An Area Efficient Universal Cryptography Processor for Smart Cards / IEEE Trans. on VLSI Systems 4:43~56
김용희 / 2008 / 스마트카드 적용을 위한 저전력 통합 암호화 엔진의 설계 / 전자공학회논문지 - SD 45(6):80~88
http : //csrc.nist.gov/encryption/ aes/rijndael/Rijndael.pdf/
Y. Zhang / 2010 / Pipelined Implementation of AES Encryption Based on FPGA / Proceeding of Information Theory and Information Security (ICITIS)
Y. Zhang / 2010 / Pipelined implementation of AES encryption based on FPGA / 2010 IEEE International Conference on Information Theory and Information Security (ICITIS) :170~173
김용희 / 2008 / 스마트카드 적용을 위한 저전력 통합 암호화 엔진의 설계 / 전자공학회논문지 - SD 45(6):80~88
http : //csrc.nist.gov/encryption/ aes/rijndael/Rijndael.pdf/
Y. Zhang / 2010 / Pipelined Implementation of AES Encryption Based on FPGA / Proceeding of Information Theory and Information Security (ICITIS)
Y. Zhang / 2010 / Pipelined implementation of AES encryption based on FPGA / 2010 IEEE International Conference on Information Theory and Information Security (ICITIS) :170~173
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