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이준서 (광운대학교) 김동호 (광운대학교) 박지환 (광운대학교) 김석훈 (광운대학교) 정한울 (광운대학교)
저널정보
대한전자공학회 대한전자공학회 학술대회 2023년도 대한전자공학회 하계학술대회 논문집
발행연도
2023.6
수록면
412 - 415 (4page)

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This paper presents a methodology for SRAM design aimed at minimizing access time while satisfying predefined constraints using Bayesian optimization (BO). During BO, the sigmoid utility functions are utilized to consider the predefined constraints, while the linear regression access time prediction model is adopted so that the design of any arbitrary capacity SRAM can be efficiently optimized based on simulation results of small capacity SRAM. According to simulation results of TSMC 28nm process, the proposed methodology reduces the SRAM access time by 10.55%, compared to the design generated by the commercial compiler, without degrading (or even improving) other circuit performance metrics.

목차

Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 구현
참고문헌

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