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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2024.11
- 수록면
- 244 - 247 (4page)
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We propose an analog voltage Refresh system for storing multi-bit weights within a single cell in a 2T1C DRAM-based Processing-In-Memory (PIM) architecture. Storing multi-bit weights as analog voltages offers high computation accuracy and efficiency in terms of area and power. However, the accuracy of MAC (Multiplication-and-Accumulation) operations degrades due to analog voltage variations caused by leakage. To address this, the proposed Refresh system periodically writes back the analog voltage to maintain computational accuracy with a minimal additional hardware. Monte Carlo simulations have confirmed that the proposed refresh system maintains a multi-level analog voltage data with an accuracy of 95%.
목차
Abstract
I. 서론
II. 본론
III. 구현 및 시뮬레이션
IV. 결론 및 향후 연구 방향
참고문헌
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