지원사업
학술연구/단체지원/교육 등 연구자 활동을 지속하도록 DBpia가 지원하고 있어요.
커뮤니티
연구자들이 자신의 연구와 전문성을 널리 알리고, 새로운 협력의 기회를 만들 수 있는 네트워킹 공간이에요.
이용수
Abstract
1. Introduction
2. Distribution Characteristic of Pseudo-Random Pattern Transitions
3. Decision to Set Optimal k-value and Transition Monitoring Window Size
4. Adoption of the Duplicated TMW
5. Results
6. References
논문 유사도에 따라 DBpia 가 추천하는 논문입니다. 함께 보면 좋을 연관 논문을 확인해보세요!
A New Low Power BIST Architecture Based on Probability Models
대한전자공학회 ISOCC
2007 .10
BIST structure based on new Random Access Scan architecture for Low Power Scan Test
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
2009 .07
IEC61850 기반의 Gateway 개발을 위한 이슈에 관한 연구
대한전기학회 학술대회 논문집
2009 .07
스캔 분할 기법을 이용한 저전력 Test-Per-Scan BIST
대한전자공학회 학술대회
2003 .07
저전력 BIST를 위한 패턴 사상(寫像) 기법에 관한 연구
전자공학회논문지-SD
2009 .05
효율적인 혼합 BIST 방법
전자공학회논문지-SD
2003 .08
TRACE : Transition Repression Architecture for low power scan CEll in BIST environment
대한전자공학회 ISOCC
2006 .10
입력신호 그룹화 방법에 의한 BIST의 테스트 시간 감소 ( Test Time Reduction of BIST by Primary Input Grouping Method )
전자공학회논문지-SD
2000 .08
도시형 친화형 저 풍속 적층 연곡형 풍력발전 시스템에 관한 연구
대한전기학회 학술대회 논문집
2010 .10
High Correlative Low Power Test Pattern Generator Using a Transition Monitoring Window
대한전자공학회 학술대회
2005 .05
An Efficient BIST (Built-in Self-test) for A/D converters
대한전자공학회 ISOCC
2007 .10
스캔입력 변형기법을 통한 새로운 저전력 스캔 BIST 구조
전자공학회논문지-SD
2008 .06
혼합 모드 BIST 테스트 패턴 생성기
전기학회논문지
1998 .07
효율적인 캐쉬 테스트 알고리듬 및 BIST 구조 ( An Effective Cache Test Algorithm and BIST Architecture )
전자공학회논문지-C
1999 .12
분할 및 병렬 처리 방법에 의한 BIST의 테스트 시간 감소
전기학회논문지 D
2000 .06
회로분할과 테스트 입력 벡터 제어를 이용한 저전력 Scan-based BIST 설계
대한전자공학회 학술대회
2001 .06
천이 감시 윈도우를 이용한 새로운 저전력 LFSR 구조
전자공학회논문지-SD
2005 .08
고장 모델 기반 메모리 BIST 회로 생성 시스템 설계
전자공학회논문지-SD
2005 .02
P1838 표준의 Memory BIST를 재활용 한 3차원으로 적층 된 플랫 메모리 자체 테스트 기법
한국통신학회 학술대회논문집
2015 .01
반도체 메모리의 Built-In Self Test ( BIST )
전자공학회지
1992 .05
0