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이용수
효율적인 혼합 BIST 방법
Ⅰ. 서론
Ⅱ. 새로운 혼합모드 테스트 방법
Ⅲ. 실험결과
Ⅳ. 결론
참고문헌
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내장형 자체 테스트 패턴 생성을 위한 하드웨어 오버헤드 축소
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메모리 테스트를 위한 BIST 기술
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1995 .12
입력신호 그룹화 방법에 의한 BIST의 테스트 시간 감소 ( Test Time Reduction of BIST by Primary Input Grouping Method )
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2000 .08
혼합 모드 BIST 테스트 패턴 생성기
전기학회논문지
1998 .07
BIST 기법을 이용한 RF 집적회로의 테스트용이화 설계
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2012 .12
혼성 신호 회로에 대한 효과적인 BIST
전자공학회논문지-SD
2002 .08
효율적인 캐쉬 테스트 알고리듬 및 BIST 구조 ( An Effective Cache Test Algorithm and BIST Architecture )
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1999 .12
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2008 .06
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An Efficient BIST (Built-in Self-test) for A/D converters
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2007 .10
내장된 자체 테스트를 위한 저전력 테스트 패턴 생성기 구조
전자공학회논문지-SD
2010 .08
A New Hardware Efficient Interconnect BIST
대한전자공학회 ISOCC
2005 .10
IEC61850 기반의 Gateway 개발을 위한 이슈에 관한 연구
대한전기학회 학술대회 논문집
2009 .07
VHDL을 이용한 테스트 알고리즘의 BIST 회로 설계
한국음향학회지
1999 .01
고밀도 메모리 테스트를 위한 랜덤 BIST의 비교분석
한국정보과학회 학술발표논문집
1997 .10
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